VHDL-FPGA-Verilog

Development Platform:

MultiPlatform

FADD4.VHD：Code Content

							--fadd4.vhd 4-bit ripple-carry adder
library ieee ;
use ieee.std_logic_1164.all;
use work.components.all;
entity fadd4 is
port(
  	a	: in std_logic_vector(3 downto 0);--砆

						